マックスシリーズ？の最後はI2Cライブラリだ。シングルマスターモード専用ではあるが、その代わりにI2Cの全モード対応に加え、実転送速度は3M近くまで達する。以前に投稿した高速なI2Cライブラリだと受信が高速化できないが、今回は、送信と受信の転送速度を別々に設定できるようにすることで実質的な転送速度を高めることができるように工夫してみた。
【送受信速度とも1Mbps】
【送信速度は1Mbps、受信速度は0.5Mbps。受信時のLOW期間の幅が変化しているのがわかる】
ちなみにであるが、定電流ダイオードをプルアップ抵抗代わりに使うと立ち上がりが改善されるようだ。参考まで。
【5V、抵抗1Kでプルアップ(5mA)】
【5V、定電流ダイオードでプルアップ(5mA)】
最大速度であるが、HISPEEDモードに対応しているADS1015(ADC)で簡単に試してみたところ、16MHz/5Vシステムでプルアップ抵抗1Kのとき次のような結果になった。
・HISPEED … 送信3M/受信3M
・FAST(PLUS) … 送信3M/受信1M(※送信速度はI2C仕様から逸脱していることに注意)
【HISPEEDモードでの波形(前半はマスターコード)】
【対応している転送モード】
・STANDARD(Max100K)
・FAST(Max400K)
・FAST-PLUS(Max1M)
・HISPEED(Max3.4M)
・ULTRA-FAST(Max5M)
【対応している仕様】
・シングルマスターモード
・７ビットアドレス(1-bit左シフトしたアドレスを指定する)
・１０ビットアドレス (アドレスに0x0100以上が指定されると１０ビットアドレスモードになる)
・ゼネラルコール
・ソフトウェアリセット
・スタートバイト
・マスターコード
・デバイスＩＤ
【対応すると遅くなるのであえて対応してない仕様】
・同期化(マルチマスタでは必要)
・調停(マルチマスタでは必要)
・クロックストレッチ(マルチマスタかスレーブ側がCPUの場合は必要)
高速化のために通信中はクロックライン(SCL)をプッシュプル駆動している。そのため他のマスタやCPU内蔵のI2C機能のようなクロックストレッチが必要なスレーブを接続すると壊れてしまう可能性があることに注意してほしい。データライン(SDA)は送信時にプッシュプル駆動し、受信時に入力に切り替えている。可能な限りショート状態にはならないようにしたつもりだが何らかの原因によるスレーブの誤動作まで考慮するとかなりリスキーな実装だ。ULTRA-FASTモードであれば一方通行なので問題ないのだが．．．それ以外のモードではショート対策として保護抵抗経由でラインに接続したほうが良いのかもしれない。
これらの意味が理解できない、デバイスを壊したくない、デバイスを壊すリスクを負いたくない人は絶対利用しないでほしい。
【コンパイル環境】
Arduino-1.6.23では(一部を除き)正しくコード生成されるのだが、Arduino-1.8.X系ではコンパイルは通るものの理解不能な警告と完璧に間違ってるコードが生成され動作せず。ソースコードの問題なのかコンパイラの問題なのか．．．わかる人いたら教えて！！
【MaxTwiクラスの概要】
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1 |
void begin(bool startByte = false) |
ライブラリを初期化する。
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1 |
void end(void) |
ライブラリを終了する。
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1 |
void softwareReset(void) |
ジェネラルソフトウェアリセットを行う。
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1 |
bool deviceId(uint8_t slave, MAXTWI_DEVICEID &id) |
デバイスＩＤを取得する。
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1 |
uint8_t write(uint16_t slave, uint8_t *buf, uint8_t len, bool sendStop = true) |
送信を行う。※7-bitアドレスは1-bit左シフトしたアドレスを指定すること。10-bitアドレスはそのまま指定する。
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1 |
uint8_t read(uint16_t slave, uint8_t *buf, uint8_t len, bool sendStop = true) |
受信を行う。※7-bitアドレスは1-bit左シフトしたアドレスを指定すること。10-bitアドレスはそのまま指定する。
【MaxWireクラスの概要(Arduino-Wire互換クラス)】
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1 |
void begin(bool startByte = false) |
ライブラリを初期化する。
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1 |
void end(void) |
ライブラリを終了する。
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1 |
void softwareReset(void) |
ジェネラルソフトウェアリセットを行う。
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1 |
bool deviceId(MAXTWI_DEVICEID &id) |
デバイＩＤを取得する。
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1 |
void beginTransmission(uint16_t address) |
送信処理を開始する。※7-bitアドレスは1-bit左シフトしたアドレスを指定すること。10-bitアドレスはそのまま指定する。
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1 |
uint8_t endTransmission(bool sendStop = true) |
送信を行う。
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1 |
uint8_t requestFrom(uint16_t address, uint8_t quantity, bool sendStop = true) |
受信を行う。※7-bitアドレスは1-bit左シフトしたアドレスを指定すること。10-bitアドレスはそのまま指定する。
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1 |
size_t write(uint8_t data) |
送信データを１バイト書き込む。
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1 |
size_t write(uint8_t *data, uint8_t len) |
送信データを複数バイト書き込む。
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1 |
int available(void) |
受信済みのバイト数を取得する。
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1 |
int read(void) |
受信データを取得する。
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1 |
int peek(void) |
受信データを調べる。
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1 |
void flush(void) |
データバッファをクリアする。
【サンプルスケッチ】
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#include "maxtwi.h" #define TWI_SDA IOPORT_PIN('B', 0) #define TWI_SCL IOPORT_PIN('B', 2) #define TWI_DEVICE 0x12 // 7-bit address #define TWI_DEVICE10 0x123 // 10-bit address #define MAXTWI MaxTwi<MAXTWI_MODE_FAST, MAXTWI_MODE_FAST, MAXTWI_MODE_FAST, TWI_SDA, TWI_SCL> void setup(void) { MAXTWI::begin(); } void loop(void) { uint8_t buf = {0x01, 0x02, 0x03}; // general software reset MAXTWI::softwareRest(); // read device id MAXTWI_DEVICEID id; MAXTWI::deviceId(TWI_DEVICE << 1, id); // 7-bit address (1 bit shift left is required) MAXTWI::write(TWI_DEVICE << 1, buf, sizeof(buf)); // 10-bit address MAXTWI::write(TWI_DEVICE10, buf, sizeof(buf)); } |
【修正履歴】
2020-07-18
修正はないが．．．有名なライブラリを公開されている人がコンパイラが壊れていると言ってるのを見つけた。不正なコード生成はやはりコンパイラのバグということで間違いなさそうだが、いまのところボードバージョンが1.6.9か1.6.11であれば完全に正しいコードが出力されることは確認した。それ以外のバージョンは最新の1.8.xも含めて正しいコードを生成することができない。一部のコードが全く生成されないという現象もあるので最適化関連のコンパイラバグではないかと思うが、だとしたらコード修正に伴なって正しいコードが生成できるバージョンが変わる可能性もあるということだ。これは厄介な問題だ．．．
2020-07-17
ULTRA_FASTモードがバグっていたので修正。
2020-07-16
masterCode()とstartByte()の呼び出しを自動で行う改良。それと、かなりバグバグしてたのであちこち修正。
あいかわずArduinoのボードバージョンを変えるとコンパイルミス(不正なコード生成)してくれたり警告が出たり出なかったりする状況が続いている。コンパイルはArduinoボードバージョンは1.6.23で行っているが、1.6.x系の一部のバージョンでも動作しないものがあるようだ。
【ライブラリ】
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/* maxtwi.h - High Speed TWI Library for AVR Series Exsample: #include "maxtwi.h" #define TWI_SDA IOPORT_PIN('B', 0) #define TWI_SCL IOPORT_PIN('B', 2) #define TWI_DEVICE 0x12 // 7-bit address #define TWI_DEVICE10 0x123 // 10-bit address #define MAXTWI MaxTwi<MAXTWI_MODE_FAST, MAXTWI_MODE_FAST, MAXTWI_MODE_FAST, TWI_SDA, TWI_SCL> void setup(void) { MAXTWI::begin(); } void loop(void) { uint8_t buf = {0x01, 0x02, 0x03}; // general software reset MAXTWI::softwareRest(); // read device id MAXTWI_DEVICEID id; MAXTWI::deviceId(TWI_DEVICE << 1, id); // 7-bit address (1 bit shift left is required) MAXTWI::write(TWI_DEVICE << 1, buf, sizeof(buf)); // 10-bit address MAXTWI::write(TWI_DEVICE10, buf, sizeof(buf)); } Copyright (c) 2020 Sasapea's Lab. All right reserved. This library is free software; you can redistribute it and/or modify it under the terms of the GNU Lesser General Public License as published by the Free Software Foundation; either version 2.1 of the License, or (at your option) any later version. This library is distributed in the hope that it will be useful, but WITHOUT ANY WARRANTY; without even the implied warranty of MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the GNU Lesser General Public License for more details. You should have received a copy of the GNU Lesser General Public License along with this library; if not, write to the Free Software Foundation, Inc., 59 Temple Place, Suite 330, Boston, MA 02111-1307 USA */ #ifndef __MAXTWI_H #define __MAXTWI_H #include <stdint.h> #include <stdbool.h> #include "ioport.h" #define MAXTWI_GCC_BUGFIX_1 1 // gcc bug fix 1 typedef enum { MAXTWI_MODE_STANDARD = 100000, // 0.1M bps (pullup 3mA) MAXTWI_MODE_FAST = 400000, // 0.4M bps (pullup 3mA) MAXTWI_MODE_FAST_PLUS = 1000000, // 1.0M bps (pullup 20mA) MAXTWI_MODE_HISPEED = 3400000, // 3.4M bps (pullup 3mA) MAXTWI_MODE_ULTRA_FAST = 5000000, // 5.0M bps (push-pull) } MAXTWI_MODE; typedef enum { MAXTWI_PROTOCOL_GENERAL_CALL = 0b00000000, MAXTWI_PROTOCOL_START_BYTE = 0b00000001, MAXTWI_PROTOCOL_CBUS = 0b00000010, MAXTWI_PROTOCOL_VARIANTS = 0b00000100, MAXTWI_PROTOCOL_RESERVED = 0b00000110, MAXTWI_PROTOCOL_MASTER_CODE = 0b00001000, MAXTWI_PROTOCOL_10BIT = 0b11110000, MAXTWI_PROTOCOL_DEVICE_ID = 0b11111000, } MAXTWI_PROTOCOL; typedef union { struct __attribute__ ((__packed__)) { uint32_t MANUFACTURER: 12; uint32_t PARTID : 9; uint32_t REVISION : 3; uint32_t RESERVED : 8; } bit; uint32_t val; } MAXTWI_DEVICEID; typedef enum { MAXTWI_MANUFACTURER_NXP_SEMICONDUCTORS = 0b000000000000, MAXTWI_MANUFACTURER_NXP_SEMICONDUCTORS_RSV1 = 0b000000000001, MAXTWI_MANUFACTURER_NXP_SEMICONDUCTORS_RSV2 = 0b000000000010, MAXTWI_MANUFACTURER_NXP_SEMICONDUCTORS_RSV3 = 0b000000000011, MAXTWI_MANUFACTURER_RAMTRON_INTERNATINAL = 0b000000000100, MAXTWI_MANUFACTURER_ANALOG_DEVICES = 0b000000000101, MAXTWI_MANUFACTURER_STMICROELECTRONICS = 0b000000000110, MAXTWI_MANUFACTURER_ON_SEMICONDUCTOR = 0b000000000111, MAXTWI_MANUFACTURER_SPRINTEK_CORPORATION = 0b000000001000, MAXTWI_MANUFACTURER_ESPROS_PHOTONICS_AG = 0b000000001001, MAXTWI_MANUFACTURER_FUJITSU_SEMICONDUCTOR = 0b000000001010, MAXTWI_MANUFACTURER_FLIR = 0b000000001011, MAXTWI_MANUFACTURER_O2_MICRO = 0b000000001100, MAXTWI_MANUFACTURER_ATMEL = 0b000000001101, } MAXTWI_MANUFACTURER; #define MAXTWI_THDSTA(m, n) \ if ((m) == MAXTWI_MODE_STANDARD ) MAXTWI_DELAY(MAXTWI_CYCLE(4.00) - (n)); \ else if ((m) == MAXTWI_MODE_FAST ) MAXTWI_DELAY(MAXTWI_CYCLE(0.60) - (n)); \ else if ((m) == MAXTWI_MODE_FAST_PLUS ) MAXTWI_DELAY(MAXTWI_CYCLE(0.26) - (n)); \ else if ((m) == MAXTWI_MODE_HISPEED ) MAXTWI_DELAY(MAXTWI_CYCLE(0.16) - (n)); \ else if ((m) == MAXTWI_MODE_ULTRA_FAST) MAXTWI_DELAY(MAXTWI_CYCLE(0.05) - (n)); #define MAXTWI_THDDAT(m) \ ((MODE == MAXTWI_MODE_STANDARD) || (MODE == MAXTWI_MODE_FAST) ? MAXTWI_CYCLE(0.30) : 0) #define MAXTWI_TSUSTA(m, n) \ if ((m) == MAXTWI_MODE_STANDARD ) MAXTWI_DELAY(MAXTWI_CYCLE(4.70) - (n)); \ else if ((m) == MAXTWI_MODE_FAST ) MAXTWI_DELAY(MAXTWI_CYCLE(0.60) - (n)); \ else if ((m) == MAXTWI_MODE_FAST_PLUS ) MAXTWI_DELAY(MAXTWI_CYCLE(0.26) - (n)); \ else if ((m) == MAXTWI_MODE_HISPEED ) MAXTWI_DELAY(MAXTWI_CYCLE(0.16) - (n)); \ else if ((m) == MAXTWI_MODE_ULTRA_FAST) MAXTWI_DELAY(MAXTWI_CYCLE(0.05) - (n)); #define MAXTWI_TSUSTO(m, n) \ if ((m) == MAXTWI_MODE_STANDARD ) MAXTWI_DELAY(MAXTWI_CYCLE(4.00) - (n)); \ else if ((m) == MAXTWI_MODE_FAST ) MAXTWI_DELAY(MAXTWI_CYCLE(0.60) - (n)); \ else if ((m) == MAXTWI_MODE_FAST_PLUS ) MAXTWI_DELAY(MAXTWI_CYCLE(0.26) - (n)); \ else if ((m) == MAXTWI_MODE_HISPEED ) MAXTWI_DELAY(MAXTWI_CYCLE(0.16) - (n)); \ else if ((m) == MAXTWI_MODE_ULTRA_FAST) MAXTWI_DELAY(MAXTWI_CYCLE(0.05) - (n)); #define MAXTWI_TBUF(m, n) \ if ((m) == MAXTWI_MODE_STANDARD ) MAXTWI_DELAY(MAXTWI_CYCLE(4.70) - (n)); \ else if ((m) == MAXTWI_MODE_FAST ) MAXTWI_DELAY(MAXTWI_CYCLE(1.30) - (n)); \ else if ((m) == MAXTWI_MODE_FAST_PLUS ) MAXTWI_DELAY(MAXTWI_CYCLE(0.50) - (n)); \ else if ((m) == MAXTWI_MODE_HISPEED ) MAXTWI_DELAY(MAXTWI_CYCLE(0.30) - (n)); \ else if ((m) == MAXTWI_MODE_ULTRA_FAST) MAXTWI_DELAY(MAXTWI_CYCLE(0.08) - (n)); #define MAXTWI_CYCLE(t) (int)(F_CPU / 1000000 * (t) + 0.5) #define MAXTWI_CLOCK(m, n, o) \ do \ { \ float clock = (float)F_CPU / (m) / 2; \ int swclk = clock + 0.5; \ int cycle = 0; \ float error = clock - swclk; \ float round = (error < 0 ? -0.5 : 0.5); \ error -= (int)error; \ if (((int)(error * (n) + round) ^ (int)(error * ((n) + 1) + round)) & 1) \ cycle += (error < 0 ? -1 : 1); \ if ((cycle += swclk - (o)) > 0) \ MAXTWI_DELAY(cycle); \ } \ while (0) #define MAXTWI_DELAY_CYCLE 3 // cycle of delay loop #define MAXTWI_DELAY(c) \ do \ { \ if ((c) > 0) \ { \ if ((c) / MAXTWI_DELAY_CYCLE) \ __asm__ volatile \ ( \ "ldi r20, %[_COUNT_]" "\n\t" \ "1: dec r20" "\n\t" \ "brne 1b" "\n\t" \ : \ : [_COUNT_] "M" ((c) / MAXTWI_DELAY_CYCLE) \ : "r20" \ ); \ if (((c) % MAXTWI_DELAY_CYCLE) > 0) \ __asm__ volatile ("nop"); \ if (((c) % MAXTWI_DELAY_CYCLE) > 1) \ __asm__ volatile ("nop"); \ } \ } \ while (0) template<MAXTWI_MODE MODE, uint32_t WRCLK, uint32_t RDCLK, uint8_t SDA, uint8_t SCL> class MaxTwi { private: static bool _startByte; static bool _started; static void start(void) { if (!_started) { _started = true; if (MODE == MAXTWI_MODE_HISPEED) masterCode(); else if (MODE == MAXTWI_MODE_ULTRA_FAST) startByte(); } // ENTRY SCL=I:H, SDA=I:H // EXIT SCL=O:H, SDA=O:L __asm__ volatile ( "sbi %[_SCLD_], %[_SCLP_]" "\n\t" "sbi %[_SDAD_], %[_SDAP_]" "\n\t" "cbi %[_SDAO_], %[_SDAP_]" "\n\t" : : [_SCLD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) , [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) ); MAXTWI_THDSTA(MODE, 6); } static void repeat(void) { // ENTRY SCL=O:H, SDA=X:X // EXIT SCL=I:H, SDA=I:H if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "ldi r18, 1 << %[_SCLP_]" "\n\t" "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "sbi %[_SDAO_], %[_SDAP_]" "\n\t" "cbi %[_SDAD_], %[_SDAP_]" "\n\t" : : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) : "r18" ); MAXTWI_CLOCK(WRCLK, 18, 9); } else { __asm__ volatile ( "ldi r18, 1 << %[_SCLP_]" "\n\t" "out %[_SCLT_], r18" "\n\t" "sbi %[_SDAO_], %[_SDAP_]" "\n\t" "cbi %[_SDAD_], %[_SDAP_]" "\n\t" : : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) : "r18" ); MAXTWI_CLOCK(WRCLK, 18, 6); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "cbi %[_SCLD_], %[_SCLP_]" "\n\t" : : [_SCLD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SCL))) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) ); MAXTWI_TSUSTA(MODE, 3); } static void stop(void) { // ENTRY SCL=O:H, SDA=X:X // EXIT SCL=I:H, SDA=I:H if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "ldi r18, 1 << %[_SCLP_]" "\n\t" "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "cbi %[_SDAO_], %[_SDAP_]" "\n\t" "sbi %[_SDAD_], %[_SDAP_]" "\n\t" : : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) : "r18" ); MAXTWI_CLOCK(WRCLK, 18, 9); } else { __asm__ volatile ( "ldi r18, 1 << %[_SCLP_]" "\n\t" "out %[_SCLT_], r18" "\n\t" "cbi %[_SDAO_], %[_SDAP_]" "\n\t" "sbi %[_SDAD_], %[_SDAP_]" "\n\t" : : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) : "r18" ); MAXTWI_CLOCK(WRCLK, 18, 6); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "cbi %[_SCLD_], %[_SCLP_]" "\n\t" : : [_SCLD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SCL))) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) ); MAXTWI_TSUSTO(MODE, 3); __asm__ volatile ( "sbi %[_SDAO_], %[_SDAP_]" "\n\t" "cbi %[_SDAD_], %[_SDAP_]" "\n\t" : : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) ); MAXTWI_TBUF(MODE, 4); _started = false; } static uint8_t writeBus(uint8_t data) { // ENTRY SCL=O:H, SDA=X:X // EXIT SCL=O:H, SDA=X:X __asm__ volatile ( "mov r25, %[_DATA_]" "\n\t" "clc" "\n\t" "sbic %[_SDAO_], %[_SDAP_]" "\n\t" "sec" "\n\t" "ror %[_DATA_]" "\n\t" "eor %[_DATA_], r25" "\n\t" "ldi r19, 1 << %[_SDAP_]" "\n\t" "ldi r18, 1 << %[_SCLP_]" "\n\t" "out %[_SCLT_], r18" "\n\t" // <-- clock start "sbrc %[_DATA_], 7" "\n\t" "out %[_SDAT_], r19" "\n\t" "sbi %[_SDAD_], %[_SDAP_]" "\n\t" : [_DATA_] "=r" (data) : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) , [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) : "r18", "r19", "r25" ); MAXTWI_CLOCK(WRCLK, 0, 4); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 1, 1); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "sbrc %[_DATA_], 6" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 2, 6); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbrc %[_DATA_], 6" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 2, 3); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 3, 1); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "sbrc %[_DATA_], 5" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 4, 6); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbrc %[_DATA_], 5" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 4, 3); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 5, 1); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "sbrc %[_DATA_], 4" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 6, 6); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbrc %[_DATA_], 4" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 6, 3); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 7, 1); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "sbrc %[_DATA_], 3" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 8, 6); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbrc %[_DATA_], 3" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 8, 3); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 9, 1); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "sbrc %[_DATA_], 2" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 10, 6); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbrc %[_DATA_], 2" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 10, 3); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 11, 1); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "sbrc %[_DATA_], 1" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 12, 6); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbrc %[_DATA_], 1" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 12, 3); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 13, 1); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "sbrc %[_DATA_], 0" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 14, 6); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbrc %[_DATA_], 0" "\n\t" "out %[_SDAT_], r19" "\n\t" : : [_DATA_] "r" (data) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SDA))) ); MAXTWI_CLOCK(WRCLK, 14, 3); } if (MODE == MAXTWI_MODE_ULTRA_FAST) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 15, 1); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbi %[_SDAO_], %[_SDAP_]" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) ); MAXTWI_CLOCK(WRCLK, 16, 3); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "clr %[_DATA_]" "\n\t" : [_DATA_] "=r" (data) : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 17, 2); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbrc r25, 0" "\n\t" // SDA short circuit protection "cbi %[_SDAD_], %[_SDAP_]" "\n\t" // : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) ); MAXTWI_CLOCK(WRCLK, 15, 3); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "cbi %[_SDAD_], %[_SDAP_]" "\n\t" "cbi %[_SDAO_], %[_SDAP_]" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) ); MAXTWI_CLOCK(RDCLK, 16, 8); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "cbi %[_SDAD_], %[_SDAP_]" "\n\t" "cbi %[_SDAO_], %[_SDAP_]" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAO_] "I" (_SFR_IO_ADDR(IOPORT_OUTREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) ); MAXTWI_CLOCK(RDCLK, 16, 5); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "in %[_DATA_], %[_SDAI_]" "\n\t" "andi %[_DATA_], 1 << %[_SDAP_]" "\n\t" : [_DATA_] "=r" (data) : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) ); MAXTWI_CLOCK(WRCLK, 17, 3); } return data; } static uint8_t readBus(uint8_t data) { // ENTRY SCL=O:H, SDA=X:L // EXIT SCL=O:H, SDA=X:L if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "mov r25, %[_DATA_]" "\n\t" "clr %[_DATA_]" "\n\t" "ldi r18, 1 << %[_SCLP_]" "\n\t" "out %[_SCLT_], r18" "\n\t" // <-- clock start "nop" "\n\t" "nop" "\n\t" "nop" "\n\t" "cbi %[_SDAD_], %[_SDAP_]" "\n\t" : [_DATA_] "=r" (data) : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) : "r18", "r25" ); MAXTWI_CLOCK(RDCLK, 0, 5); } else { __asm__ volatile ( "mov r25, %[_DATA_]" "\n\t" "clr %[_DATA_]" "\n\t" "ldi r18, 1 << %[_SCLP_]" "\n\t" "out %[_SCLT_], r18" "\n\t" // <-- clock start "cbi %[_SDAD_], %[_SDAP_]" "\n\t" : [_DATA_] "=r" (data) : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) : "r18", "r25" ); MAXTWI_CLOCK(RDCLK, 0, 2); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbic %[_SDAI_], %[_SDAP_]" "\n\t" "ori %[_DATA_], 0x80" "\n\t" : [_DATA_] "=r" (data) : [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) , [_SCLP_] "I" (IOPORT_PINPOS(SCL)) ); MAXTWI_CLOCK(WRCLK, 1, 3); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 2, 1); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbic %[_SDAI_], %[_SDAP_]" "\n\t" "ori %[_DATA_], 0x40" "\n\t" : [_DATA_] "=r" (data) : [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 3, 3); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 4, 1); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbic %[_SDAI_], %[_SDAP_]" "\n\t" "ori %[_DATA_], 0x20" "\n\t" : [_DATA_] "=r" (data) : [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 5, 3); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 6, 1); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbic %[_SDAI_], %[_SDAP_]" "\n\t" "ori %[_DATA_], 0x10" "\n\t" : [_DATA_] "=r" (data) : [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 7, 3); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 8, 1); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbic %[_SDAI_], %[_SDAP_]" "\n\t" "ori %[_DATA_], 0x08" "\n\t" : [_DATA_] "=r" (data) : [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 9, 3); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 10, 1); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbic %[_SDAI_], %[_SDAP_]" "\n\t" "ori %[_DATA_], 0x04" "\n\t" : [_DATA_] "=r" (data) : [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 11, 3); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 12, 1); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbic %[_SDAI_], %[_SDAP_]" "\n\t" "ori %[_DATA_], 0x02" "\n\t" : [_DATA_] "=r" (data) : [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 13, 3); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 14, 1); __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "sbic %[_SDAI_], %[_SDAP_]" "\n\t" "ori %[_DATA_], 0x01" "\n\t" : [_DATA_] "=r" (data) : [_SDAI_] "I" (_SFR_IO_ADDR(IOPORT_INREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 15, 3); if (MAXTWI_THDDAT(MODE)) { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" "nop" "\n\t" "nop" "\n\t" #if (MAXTWI_GCC_BUGFIX_1) "nop" "\n\t" #else "cpse r25, __zero_reg__" "\n\t" #endif "sbi %[_SDAD_], %[_SDAP_]" "\n\t" : : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 16, 5); } else { __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" #if (MAXTWI_GCC_BUGFIX_1) "nop" "\n\t" #else "cpse r25, __zero_reg__" "\n\t" #endif "sbi %[_SDAD_], %[_SDAP_]" "\n\t" : : [_SDAD_] "I" (_SFR_IO_ADDR(IOPORT_DIRREG(SDA))) , [_SDAP_] "I" (IOPORT_PINPOS(SDA)) , [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(RDCLK, 16, 3); } __asm__ volatile ( "out %[_SCLT_], r18" "\n\t" : : [_SCLT_] "I" (_SFR_IO_ADDR(IOPORT_TGLREG(SCL))) ); MAXTWI_CLOCK(WRCLK, 17, 1); return data; } static void startByte(void) { if (_startByte) write(MAXTWI_PROTOCOL_START_BYTE, 0, 0, false); } static void masterCode(uint8_t code = 1) { MaxTwi<MAXTWI_MODE_FAST, MAXTWI_MODE_FAST, MAXTWI_MODE_FAST, SDA, SCL>::write(MAXTWI_PROTOCOL_MASTER_CODE | (uint8_t)(code & 7), 0, 0, false); } public: static void begin(bool startByte = false) { _startByte = startByte; IOPORT::pinMode(SDA, INPUT_PULLUP); IOPORT::pinMode(SCL, INPUT_PULLUP); } static void end(void) { IOPORT::pinMode(SDA, INPUT); IOPORT::pinMode(SCL, INPUT); } static void softwareReset(void) { uint8_t cmd = 0x06; // reset command write(MAXTWI_PROTOCOL_GENERAL_CALL, &cmd, sizeof(cmd)); } static bool deviceId(uint8_t slave, MAXTWI_DEVICEID &id) { write(MAXTWI_PROTOCOL_DEVICE_ID, &slave, sizeof(slave), false); return read(MAXTWI_PROTOCOL_DEVICE_ID, (uint8_t *)&id, 3) == 3; } static uint8_t write(uint16_t slave, uint8_t *buf, uint8_t len, bool sendStop = true) { uint8_t cnt = 0xFF; uint8_t data = (uint8_t)slave; start(); if ((uint8_t)(slave >> 8)) writeBus(MAXTWI_PROTOCOL_10BIT | (((slave >> 8) & 3) << 1)); else if ((data > (MAXTWI_PROTOCOL_MASTER_CODE | 7)) && (data < MAXTWI_PROTOCOL_10BIT)) data &= ~1; while (writeBus(data) == 0) { if (++cnt >= len) break; data = *buf++; } if (sendStop) stop(); else repeat(); return cnt; } static uint8_t read(uint16_t slave, uint8_t *buf, uint8_t len, bool sendStop = true) { uint8_t cnt = 0xFF; if ((uint8_t)(slave >> 8)) { write(slave, 0, 0, false); slave = MAXTWI_PROTOCOL_10BIT; } start(); if (writeBus(slave | 1) == 0) { while (++cnt < len) *buf++ = readBus(len - cnt - 1); // gcc BUG --> (len - cnt - 1) compile miss. } if (sendStop) stop(); else repeat(); return cnt; } }; template<MAXTWI_MODE MODE, uint32_t WRCLK, uint32_t RDCLK, uint8_t SDA, uint8_t SCL> bool MaxTwi<MODE, WRCLK, RDCLK, SDA, SCL>::_startByte = false; template<MAXTWI_MODE MODE, uint32_t WRCLK, uint32_t RDCLK, uint8_t SDA, uint8_t SCL> bool MaxTwi<MODE, WRCLK, RDCLK, SDA, SCL>::_started = false; template<MAXTWI_MODE MODE, uint32_t WRCLK, uint32_t RDCLK, uint8_t SDA, uint8_t SCL, uint8_t BUFFER_LENGTH = 32> class MaxWire { private: uint8_t _buffer[BUFFER_LENGTH]; uint8_t _count; uint8_t _index; uint8_t _error; uint16_t _addr; public: MaxWire(void) : _count(0) , _index(0) , _error(0) , _addr(0) { } virtual ~MaxWire(void) { } void begin(bool startByte = false) { MaxTwi<MODE, WRCLK, RDCLK, SDA, SCL>::begin(startByte); } void end(void) { MaxTwi<MODE, WRCLK, RDCLK, SDA, SCL>::end(); } void softwareReset(void) { MaxTwi<MODE, WRCLK, RDCLK, SDA, SCL>::softwareReset(); } bool deviceId(MAXTWI_DEVICEID &id) { return MaxTwi<MODE, WRCLK, RDCLK, SDA, SCL>::deviceId(_addr, id); } void beginTransmission(uint16_t address) { _addr = address; _count = 0; _index = 0; _error = 0; } uint8_t endTransmission(bool sendStop = true) { if (_error) return 1; // buffer overflow uint8_t rv = MaxTwi<MODE, WRCLK, RDCLK, SDA, SCL>::write(_addr, _buffer, _index, sendStop); return rv == _index ? 0 : (rv == 0xFF ? 2 : 3); } uint8_t requestFrom(uint16_t address, uint8_t quantity, bool sendStop = true) { // clamp to buffer length if (quantity > BUFFER_LENGTH) quantity = BUFFER_LENGTH; // perform blocking read into buffer int read = MaxTwi<MODE, WRCLK, RDCLK, SDA, SCL>::read(address, _buffer, quantity, sendStop); // set rx buffer iterator vars _count = read > 0 ? (uint8_t)read : 0; _index = 0; return _count; } virtual size_t write(uint8_t data) { // don't bother if buffer is full if (_index >= BUFFER_LENGTH) { _error = 1; return 0; } // put byte in tx buffer _buffer[_index++] = data; return 1; } virtual size_t write(uint8_t *data, uint8_t len) { uint8_t cnt = 0; while (cnt < len) { if (write(*data++) == 0) break; ++cnt; } return cnt; } virtual int available(void) { return (_index < _count ? _count - _index : 0); } virtual int read(void) { return _index < _count ? _buffer[_index++] : -1; } virtual int peek(void) { return _index < _count ? _buffer[_index] : -1; } virtual void flush(void) { _count = 0; _index = 0; _error = 0; } }; #endif |
【参照ライブラリ】
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